DC-DC的開關節(jié)點振鈴波電磁干擾控制
由于電源效率變得越來越重要，會使用更高的開關速度來降低損耗，現(xiàn)常見的開關速度已經到2.1MHz，然而開關速度（指MOS上升時間和下降時間變短）提高以后，電磁干擾EMI隨之增加。同步降壓DC-DC中，高速開關的場效應管在開關節(jié)點會有巨大的電壓過沖和振鈴，振鈴的大小與高側MOS的開關速度以及布局和FET的封裝的雜散電感有關，我們必須選擇正確的電路和布局設計方法，以將這種振鈴維持在同步FET最大絕對額定值以下。
本節(jié)從消除振鈴的角度出發(fā)（而不是后端濾波磁珠等靜噪手段）介紹三種電路設計，在良好的電源布局前提下，利用一個自舉電阻，一個高側柵極電阻，或者一個緩沖器來控制開關節(jié)點振鈴。
01 寄生帶來的振鈴
圖1顯示的是一個同步降壓DC-DC的功率級組件模型，該模塊中包含一些寄生電感和電容，其中紅色部分是寄生元件，它們是產生開關節(jié)點振鈴的原因。
假設該轉換器狀態(tài)穩(wěn)定，在低側FET開啟時的部分開關周期，負載功率僅通過輸出電感和電容提供，這樣能量存儲于寄生電感，E=1/2L×I2。在開關周期末尾，轉換器將會把低側FET關閉，并將高側FET重新開啟，目的是為輸出L重新提供功率。
圖1 降壓DC-DC的寄生模型
一些高性能柵極驅動器和一個高速開關FET可以使低側FET快速關閉，假設負載狀態(tài)足以讓電感電流持續(xù)流至輸出，則電流被分流至低側FET的體二極管，并且能量保留在低側FET的寄生漏極和源極電感中，而來自低側和高側FET寄生電感的能量會以開關節(jié)點LC振蕩波形的形式出現(xiàn)。
這種振鈴的電壓大小可超出低側MOS的絕對漏-源電壓，一般高速開關MOS都使用了一個堆棧式MOS對，通過一些創(chuàng)新的封裝技術控制這些寄生電感。
02 降低振鈴
使用一個1.1V-20A降壓DC-DC測試電路用于表明開關節(jié)點振鈴的影響，該電路使用驅動器+高速開關FET電源模塊，工作頻率輸600KHz，輸入電壓范圍8-16V，圖2是沒有連接自舉電阻器，高側柵極電阻器或者緩沖器的開關節(jié)點波形，從波形圖中可以看到12V輸入時，峰值振鈴為23.4V，最大負載的效率為87.2%。
圖2 時間-50ns/div；原始振鈴波形-5V/div
圖3 時間-50ns/div；增加自舉電阻振鈴波形-5V/div
圖4 時間-50ns/div；增加高側柵極電阻振鈴波形-5V/div
圖5 時間-50ns/div；增加緩沖器振鈴波形-5V/div
對自舉電阻器、高側柵極電阻器和緩沖器進行了優(yōu)化，以將這種電壓過沖降低至20V以下，這種電壓過沖控制方法為FET保護提供了一定的裕量，而FET的最大額定電壓為30V。圖2至圖5顯示了初始電路的過沖和使用自舉電阻器、柵極電阻器和緩沖器降低后的振鈴過沖。
柵極電阻器的波形與自舉電阻器非常類似，需要注意的是，僅振鈴的量級受到了自舉電阻器和柵極電阻器方法的影響，緩沖器方法還改變了振鈴頻率，并漸次減弱振鈴波形，圖6顯示了每種狀態(tài)的測得效率。
圖6 效率與負載電流的關系
表1 三種振鈴降低方法測試
03 自舉電阻器
圖1中所示充電泵電路利用Cboot來將高側柵極電源電壓升壓至功率級電源電壓以上，降低振鈴的一種方法是用一個自舉電阻器與自舉電容串聯(lián)，降低高側FET的開啟速度。這樣做讓寄生網絡有更多的時間來放電，最終達到控制振鈴的目的。
確定該自舉電阻器值的方法是：從0Ω開始，然后逐漸增加電阻，直到出現(xiàn)理想的振鈴程度為止。本例要想將這種設計的振鈴降低至20V以下，則必須使用一個6.8Ω自舉電阻器，該自舉電容器僅僅影響高側FET的開啟，從而讓這種方法成為降低振鈴的一種有效方法。
但是如果自舉電阻器過大，則自舉電容可能不會在每個周期都獲得完全充電，這種情況下，柵極驅動器可能沒有足夠的電壓來讓高側FET保持開啟，并可能會在周期的中間關閉高側FET，這樣便限制了可以利用自舉電阻器方法降低的振鈴量。
04 高側柵極電阻器
同自舉電阻器方法類似，高側FET柵極串聯(lián)的電阻器減慢高側FET的開啟，但是由于該電阻與柵極串聯(lián)，它也在放電通路中，因此它同時也減慢了關閉的速度。為了把這種設計的振鈴降低至20V以下，我們使用了一個6.8Ω的柵極電阻器，這種方法是三種方法中效率最低的一種。
05 緩沖器
緩沖器電路由一個電阻器和一個電容組成，它們與開關節(jié)點和接地以串聯(lián)的方式連接。緩沖器電路用于減少開關過渡期間的寄生電感和電容，這種電路降低了振鈴電壓和頻率，同時也減少了振鈴周期數(shù)，可以幫助降低系統(tǒng)產生的EMI。
選擇電容和電阻器件組件時，首先應測量原始電路的振鈴頻率。一旦確定了頻率，便可將一個電容放同低側FET并聯(lián)放置，將振鈴頻率改變?yōu)樵贾档囊话?，當頻率為原始值的一半時，該并聯(lián)電容值便等于原始電路寄生電容的三倍。知道電容和頻率以后，我們便可以通過公式：
計算出寄生電容，其中f為原始振鈴頻率，而C為寄生電容，電路阻尼電阻器的值可以通過方程式：
計算得到，該電阻器可能會也可能不會提供必要的振鈴控制。增加電阻值會產生一個弱阻尼系統(tǒng)，其有更多振鈴存在，但卻可以降低功耗。增加電容可以降低振鈴，但會增加功耗，就本例而言，使用一個2200pF電容和一個1Ω電阻以后，振鈴降低至19.1V。
06 小結
① 自舉電阻器可在不影響關閉的情況下減慢高側FET的開啟，是最為有效的一種方法，但是如果使用這種方法，則必須注意防止讓柵極缺電荷。
② 一個電阻器與柵極串聯(lián)，可同時增加高側MOSFET的開啟與關閉時間，從而對開關節(jié)點升降振鈴進行控制，但這種方法消耗掉了高側FET的大多數(shù)功率，因此效率較低。
③ RC緩沖器可以降低振鈴的頻率和過沖，但是它要求使用兩個額外組件，并且在輕負載條件下效率較低。
每一種電源設計都有其優(yōu)缺點，因此我們應該認真研究每一種方法，了解其給電源帶來的成本/好處。最好的方法可能是組合使用所有三種電路，最終目標是在盡可能保持功率級高效率的同時，在MOSFET最大額定電壓以下維持足夠的安全裕量。
這三種方法適用的場景也有所不同，Rgate只能適用于MOS分立的情況，而Rboot只能適用于有外置Cboot的情況，緩沖電路則分立與集成都比較適用。
